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751. 纳米CMOS集成电路时钟分布网络SET敏感性及加固设计研究
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752. 基于28nm CMOS工艺的自适应锁相环研究与设计
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753. 应用于CMOS图像传感器的高性能列读出电路关键技术研究
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754. 基于65nm CMOS工艺集成电路标准单元单粒子效应加固技术研究
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755. 基于7nm CMOS工艺图形处理器芯片子模块后端实现
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756. 基于CMOS工艺的单光子雪崩二极管机理、模型及器件优化研究
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757. 多模多标准CMOS锁相环频率综合器中小数分频器的设计
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758. 0.3～3GHz SOI CMOS低功耗低噪声放大器设计
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759. 0.13微米CMOS逻辑工艺和片上集成无源器件的开发
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760. 一种用于10Gb/s Serdes的40nm CMOS锁相环
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