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81. DDR1抑制剂与IGF-1R抑制剂联合应用及机制
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82. 基于DDR3的CMOS高速图像采集系统的FPGA设计与实现
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83. 基于PLB4总线的DDR3控制器的设计与优化
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84. 基于AXI4的卫星接收机DDR3多端口存储的设计
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85. DDR2 SDRAM控制器IP功能测试与FPGA验证
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86. 数字三维示波器中DDR3存储模块的硬件设计与实现
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87. DDR3与FPGA接口的高速电路板信号完整性分析
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88. Wnt/β-catenin信号途径在DDR和氧化应激中的作用
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89. 基于FPGA的DDR2 SDRAM UDIMM内存故障注入工具的设计
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90. 基于协议控制器的DDR3访存控制器的设计及优化
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